Sharp XE-A203 Service Manual - Page 17

Circuit Diagram And Pwb Layout - cd

Page 17 highlights

8 7 6 5 4 3 2 1 CHAPTER 6. CIRCUIT DIAGRAM AND PWB LAYOUT ■ MAIN PWB 1/4 XE-A203U/XE-A203A CIRCUIT DIAGRAM AND PWB LAYOUT - 15 - CPU CIRCUIT VCC D R1 R2 R3 R4 VCC RP2 10K 6 7 8 9 10K 10K 10K 10K A7 A6 A5 A4 A3 A2 A1 A0 2 ENA1 2 ENA2 2 IN1 2 IN2 2 KST3 2 KST2 2 KST1 2 KST0 C1 C2 C3 C4 R25 R26 R27 R28 100pF*4(C10-C13) 10K 10K 10K 10K 5 4 3 2 1 9 8 7 6 5 4 VCC RP3 10K VCC 3 2 1 D[0..7] D[0..7] VCC D A[0..16] A[0..16] C5 0.1uF IC1 A8 A9 A10 A11 A12 D0 D1 D2 D3 D4 D5 D6 D7 3 4 7 8 D0 D1 D2 D3 13 14 17 18 D4 D5 D6 D7 Q0 Q1 Q2 Q3 2 5 6 9 Q4 Q5 Q6 Q7 12 15 16 19 a b c d e f g dp a b c d e f g dp 2 2 2 2 2 2 2 2 A13 A14 A15 1 11 OC CLK VCC:20pin GND:10pin VCC A16 74HC374 R12 10K R5 R24 R23 10K 10K 10K R22 R21 10K 10K VDD 1 C6 0.1uF C7 + /WR C9 33pF NOT INSTALL RP1 VCC VCC 10K C R37 R38 VCC R16 C11 33pF VCC 2 10uF/50V VCC C R13 80 79 78 77 76 75 74 73 72 71 70 69 68 67 66 65 64 63 62 61 60 59 58 57 56 55 54 53 52 51 9 8 7 6 5 4 3 2 1 10K 10K 10K D8 D9 D10 D11 D12 D13 D14 D15 A0 A1 A2 A3 A4 A5 A6 A7 VSS A8 VCC A9 A10 A11 A12 A13 A14 A15 A16 A17 A18 A19 D7 D6 D5 D4 D3 D2 D1 D0 2 /STB1 2 /LAT 3 VPON R41 33 R43 33 R44 33 R45 33 R46 33 R47 33 R48 33 R49 33 81 82 83 D7 D6 D5 84 85 86 87 D4 D3 D2 D1 88 89 90 91 D0 AN7 AN6 AN5 IC2 FLASH M30626FHPFP 1006P6S-A MASK M30624MWP-XXXFP 3 VBAT 2 /STB2 2 P101 92 93 94 95 AN4 AN3 AN2 AN1 2 VCC 2 1 P100 P97 VDD 96 97 98 99 100 AVSS AN0 VREF AVCC SIN4 + C10 CS0 CS1 CS2 50 49 48 CS3 WR BHE RD 47 46 45 44 CBCLK HLDA HOLD ALE 43 42 41 40 CLKOUT RTS0 CLK0 RXD0 39 38 37 36 TXD0 CLKS1 CLK1 RXD1 TXD1 35 34 33 32 31 10K TP1 /CS0 /CS1 /CS2 /WR /RD R17 10k C8 33pF SD_CLK SD_RXD SD_TXD /SD_POWER /SD_CS /SD_CD /SD_WP DR1 2 SD_CLK 4 SD_RXD 4 SD_TXD 4 /SD_POW 4 /SD_CS 4 /SD_CD 4 /SD_WP 4 VDD /RD IC3 A16 A14 A12 A7 A6 A5 A4 A3 A2 A1 A0 D0 D1 D2 1 2 NC A16 3 4 5 6 A14 A12 A7 A6 7 8 9 10 A5 A4 A3 A2 11 12 13 14 A1 A0 I/O0 I/O1 15 16 I/O2 VSS VCC A15 32 31 CS2 WE A13 A8 30 29 28 27 A9 A11 OE A10 26 25 24 23 CS1 I/O7 I/O6 I/O5 22 21 20 19 I/O4 I/O3 18 17 C12 A15 33pF NOT INSTALL A13 A8 A9 A11 A10 VDD D7 D6 D5 R14 D4 10K D3 LP621024DM-70MM/ CY62128BLL-70SXC SOIC C18 /CS2 NOT INSTALL 33pF SOUT4 CLK4 TB4IN TB3IN SOUT3 SIN3 CLK3 BYTE CNVSS XCIN XCOUT RESET XOUT VSS XIN VCC NMI INT2 INT1 INT0 TA4IN/U TA4OUT/U TB3IN TBEOUT TA2INW TA2OUTW TA1IN/V TA1OUT/V TB5IN TB5OUT 2 4.7UF/50V VDD VCC R39 R51 VCC VCC VCC Not Install 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 R53 47K R15 R42 10K Not Install IC6 C19 VCC CN3 B ONLY QA0/QA1 USE /SD_CD R64 /SD_WP R65 CNVss 0 RXDPRG 0 TXDPRG TEST PIN 100K 5 4 3 2 C13 2 P96 2 P95 1 1000pF 2 2 P94 P93 VDD 2 P92 2 P91 2 P90 R58 1K /RESUSB 2 10K 10K R50 R42 XE-A20W ONLY DAT 2 10K CLK 2 D1 R40 B +BZ1 R52 PIEZO BZ 10K D0 D1 D2 D3 D4 D5 D6 D7 2 3 4 5 A0 A1 A2 A3 6 7 8 9 A4 A5 A6 A7 /RD /CS1 1 19 DIR G B0 B1 B2 B3 18 17 16 15 B4 B5 B6 B7 14 13 12 11 BD0 BD1 BD2 BD3 BD4 BD5 BD6 BD7 74ALS645 VCC3 0.1uF VCC CN2 BD[0..7] 1 2 3 BD0 4 BD1 5 BD2 6 BD3 7 BD4 8 BD5 9 B 2 /RESET 54 123 BD5228 R56 3.3K R57 820 C14 100pF Reset IC IC4 1 2 OUT VDD 3 VSS CD 5 4 NC BD5228/ S80928 rohm SII C15 2200pF CNVss R62 R61 R60 47K C20 18pF 0 330 X2 1 2 C21 27pF 32.768KHz 1 2 3 /DREQUSB /INTUSB X3 MOTOR /POFF 2 3 VCC 1 1SS133 VCC3 D0 D1 C24 D2 D3 D4 0.1uF D5 D6 D7 10K R40 XE-A203U/A ONLY 1 2 3 4 5 6 7 8 9 10 11 2 1 VDD + C17 C16 0.1uF IC7 A0 2 A1 3 A2 4 A3 5 A4 6 A5 7 A6 8 /CS1 9 /WR 10 /RD 11 1 13 A1 A2 A3 A4 A5 A6 A7 A8 A9 A10 OE1 OE2 Y1 Y2 23 22 Y3 Y4 Y5 Y6 Y7 Y8 Y9 Y10 21 20 19 18 17 16 15 14 BA0 BA1 BA2 BA3 BA4 BA5 BA6 /CS1B /WR_B /RD_B 74ABT827 BD6 10 BD7 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 X1 CSTLF12M A0 12 26 A 3 2 1 R63 3.3K IC5 1 XIN 2 3 4 XOUT S1 LF VDD 8 S0 FSOUT VSS 7 6 5 FS781 C22 0.1uF 1 VCC Not Install C23 + 10uF/10V,OS VCC R18 R19 R20 10K 10K 10K A1 13 A2 14 A3 15 A4 16 A5 17 A6 18 /CS1 19 /WR 20 10uF/50V,AL /DREQUSB /INTUSB /RESUSB_B 1.0-11-26P A CST12.0MTW 2 /RD 21 C25 /DREQUSB 22 330pF R66 /INTUSB 23 /RESUSB_B 24 25 R70 0 C27 26 C26 33 91pF 1000pF CN1 52806-2610 TO USB 8 7 6 5 4 3 2 1

  • 1
  • 2
  • 3
  • 4
  • 5
  • 6
  • 7
  • 8
  • 9
  • 10
  • 11
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  • 29
  • 30
  • 31

XE-A203U/XE-A203A
CIRCUIT DIAGRAM AND PWB LAYOUT
– 15 –
Not Install
rohm
Reset IC
VCC:20pin
GND:10pin
100pF*4(C10-C13)
Not Install
SII
TO USB
R42 XE-A20W ONLY
R40 XE-A203U/A ONLY
1
3
2
5
4
BD5228
ONLY QA0/QA1 USE
NOT INSTALL
NOT INSTALL
NOT INSTALL
Not Install
MASK
M30624MWP-XXXFP
/WR
BD4
BD0
A13
A10
D1
A4
/WR_B
D1
D5
D1
BA0
/CS1
BD4
/SD_POWER
A6
D6
/SD_WP
A2
D3
D7
/RD
A1
BD7
A2
BD6
SD_TXD
A5
D5
RXDPRG
BD5
D6
D3
D4
c
D3
A5
BD0
g
SD_RXD
/RESUSB_B
/RD
D4
D2
BD5
A[0..16]
D0
A9
/DREQUSB
/DREQUSB
f
A6
BA1
D7
D7
BA3
A6
D2
D5
CNVss
D2
D2
/RESUSB_B
D0
A0
BA4
A1
D5
A0
A7
A3
/SD_WP
b
BD[0..7]
BD1
A3
A11
/INTUSB
/INTUSB
D1
/CS1
/CS1B
/SD_CS
D0
A16
A2
BD6
e
BA2
A8
a
d
/SD_CD
D4
A12
A5
CNVss
A15
BD3
D4
D7
A3
/WR
BD2
BD1
D[0..7]
D0
/DREQUSB
BD2
/INTUSB
A4
A4
/CS1
/RESUSB
BD3
BD7
dp
D3
D6
A14
TXDPRG
/RD
BA6
/SD_CD
D6
A1
BA5
A0
/RD_B
SD_CLK
/CS0
A1
D5
D0
A[0..16]
A12
/WR
/RD
/SD_CD
4
/WR
/CS2
A5
A15
f
2
A6
a
2
D7
P101
2
CLK
2
A3
D2
A0
A2
/SD_POW
4
A4
e
2
P95
2
KST0
2
/CS1
/POFF
3
P96
2
ENA1
2
P91
2
DAT
2
A9
/LAT
2
D4
D[0..7]
/RESET
2
/CS2
/RD
ENA2
2
P97
2
P94
2
VPON
3
d
2
A14
KST3
2
/STB2
2
D6
P93
2
P90
2
IN2
2
dp
2
/SD_CS
4
KST2
2
VBAT
3
D1
A11
KST1
2
MOTOR
2
IN1
2
A13
A16
A7
SD_RXD
4
/STB1
2
c
2
D3
P100
2
DR1
2
/SD_WP
4
A8
g
2
b
2
P92
2
A10
SD_CLK
4
SD_TXD
4
VCC
VDD
VCC
VCC
VCC
VCC3
VCC
VCC
VCC
VCC
VDD
VCC
VCC
VCC
VDD
VCC
VCC
VCC
VCC
VCC
VCC3
VCC
VCC
VDD
VDD
VDD
VDD
VCC
VCC
VCC
R60
47K
CN3
TEST PIN
1
2
3
4
5
C6
0.1uF
R48
33
+
C10
4.7UF/50V
1
2
R70
0
R47
33
C8
33pF
R13
10K
R64
0
R28
10K
IC3
LP621024DM-70MM/ CY62128BLL-70SXC SOIC
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
NC
A16
A14
A12
A7
A6
A5
A4
A3
A2
A1
A0
I/O0
I/O1
I/O2
VSS
I/O3
I/O4
I/O5
I/O6
I/O7
CS1
A10
OE
A11
A9
A8
A13
WE
CS2
A15
VCC
IC2
FLASH
M30626FHPFP 1006P6S-A
81
80
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
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18
19
20
21
22
23
24
25
26
27
28
29
30
79
78
77
76
75
74
73
72
71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
D7
D8
D6
D5
D4
D3
D2
D1
D0
AN7
AN6
AN5
AN4
AN3
AN2
AN1
AVSS
AN0
VREF
AVCC
SIN4
SOUT4
CLK4
TB4IN
TB3IN
SOUT3
SIN3
CLK3
BYTE
CNVSS
XCIN
XCOUT
RESET
XOUT
VSS
XIN
VCC
NMI
INT2
INT1
INT0
TA4IN/U
TA4OUT/U
TB3IN
TBEOUT
TA2INW
TA2OUTW
TA1IN/V
TA1OUT/V
TB5IN
TB5OUT
D9
D10
D11
D12
D13
D14
D15
A0
A1
A2
A3
A4
A5
A6
A7
VSS
A8
VCC
A9
A10
A11
A12
A13
A14
A15
A16
A17
A18
A19
CS0
CS1
CS2
CS3
WR
BHE
RD
CBCLK
HLDA
HOLD
ALE
CLKOUT
RTS0
CLK0
RXD0
TXD0
CLKS1
CLK1
RXD1
TXD1
R14
10K
R21
10K
+
C7
10uF/50V
1
2
R38
10K
R56
3.3K
C26
91pF
R46
33
C18
33pF
R2
10K
C4
R45
33
X3
CSTLF12M
2
3
1
R39
10K
R57
820
D1
1SS133
1
2
C14
100pF
R49
33
R65
0
R12
10K
C9
33pF
R44
33
+
C23
10uF/10V,OS
1
2
R1
10K
CN1
52806-2610
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
IC4
BD5228/ S80928
2
3
1
5
4
VDD
VSS
OUT
CD
NC
R63
3.3K
IC7
74ABT827
23
22
21
20
19
18
17
16
2
3
4
5
6
7
8
9
13
1
10
11
15
14
Y1
Y2
Y3
Y4
Y5
Y6
Y7
Y8
A1
A2
A3
A4
A5
A6
A7
A8
OE2
OE1
A9
A10
Y9
Y10
C24
0.1uF
R40
10K
R19
10K
R25
10K
RP2
10K
3
2
1
4
5
6
7
8
9
R50
10K
R43
33
R16
10K
X1
CST12.0MTW
2
3
1
RP3
10K
3
2
1
4
5
6
7
8
9
R23
10K
R26
10K
R52
10K
IC5
FS781
1
2
3
4
5
6
7
8
XIN
XOUT
S1
LF
VSS
FSOUT
S0
VDD
R51
47K
CN2
1.0-11-26P
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
C1
R37
10K
R42
10K
B
+
BZ1
PIEZO BZ
R3
10K
TP1
IC6
74ALS645
2
3
4
5
6
7
8
9
19
1
18
17
16
15
14
13
12
11
A0
A1
A2
A3
A4
A5
A6
A7
G
DIR
B0
B1
B2
B3
B4
B5
B6
B7
+
C16
10uF/50V,AL
1
2
C21
27pF
C12
33pF
R53
100K
R62
330
R61
0
R41
33
X2
32.768KHz
1
2
R24
10K
C20
18pF
C19
0.1uF
RP1
10K
3
2
1
4
5
6
7
8
9
R58
1K
R18
10K
R17
10k
C22
0.1uF
R4
10K
R5
10K
C25
330pF
IC1
74HC374
3
4
7
8
13
14
17
18
1
11
2
5
6
9
12
15
16
19
D0
D1
D2
D3
D4
D5
D6
D7
OC
CLK
Q0
Q1
Q2
Q3
Q4
Q5
Q6
Q7
C17
0.1uF
C2
R66
33
C3
C27
1000pF
C11
33pF
R20
10K
C13
1000pF
R15
10K
R27
10K
C15
2200pF
C5
0.1uF
R22
10K
A
B
C
D
8
7
6
5
4
3
2
1
1
2
3
4
5
6
7
8
D
C
B
A
A
B
C
D
8
7
6
5
4
3
2
1
1
2
3
4
5
6
7
8
D
C
B
A
A
B
C
D
8
7
6
5
4
3
2
1
1
2
3
4
5
6
7
8
D
C
B
A
A
B
C
D
8
7
6
5
4
3
2
1
1
2
3
4
5
6
7
8
D
C
B
A
1/4
CPU CIRCUIT
CHAPTER 6. CIRCUIT DIAGRAM AND PWB LAYOUT
MAIN PWB